《EDA技术与数字系统设计》PDF下载

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  • 作  者:尹常永主编
  • 出 版 社:西安:西安电子科技大学出版社
  • 出版年份:2004
  • ISBN:7560614280
  • 页数:210 页
图书介绍:本书介绍了EDA技术的基础知识和设计方法。

第1章 EDA技术概述 1

1.1 EDA技术的发展史 1

目录 1

1.2 EDA技术的主要内容 2

1.2.1大规模可编程逻辑器件 3

1.2.2软件开发工具 3

1.2.3输入方式 4

1.2.4相关厂商概述 4

1.3 EDA技术的发展趋势 5

1.3.1可编程器件的发展趋势 5

1.3.2软件开发工具的发展趋势 6

1.3.3输入方式的发展趋势 7

2.1组合逻辑电路设计的一般方法 9

第2章 常用数字电路的设计方法 9

2.2 时序逻辑电路的设计 10

第3章数字系统的设计 15

3.1数字系统设计概述 15

3.1.1数字系统的组成 15

3.1.2数字系统的设计方法 15

3.1.3数字系统设计的一般过程 16

3.2数字系统的描述方法 17

3.2.1寄存器传输语言 17

3.2.2算法状态机图(ASM图) 19

3.2.3备有记忆文档的状态图(MDS) 20

3.3.2设计过程 22

3.3.1设计任务 22

3.3数字系统设计实例 22

第4章 VHDL语言基础 25

4.1 VHDL概述 25

4.1.1 VHDL语言的起源 25

4.1.2 VHDL语言的特点 25

4.2 VHDL的基本结构 25

4.2.1 实体(ENTITY) 27

4.2.2结构体(ARCHITECTURE) 28

4.2.3库(LIBRARY) 30

4.2.4程序包(PACKAGE) 32

4.2.5配置(CONFIGURATION) 34

4.3.1 VHDL的文字规则 36

4.3 VHDL的数据及文字规则 36

4.3.2 VHDL的数据对象(Data Object…) 38

4.3.3 VHDL的数据类型(Data Type) 41

4.3.4 VHDL的类型转换 47

4.4 VHDL的操作符(Operator) 50

4.4.1操作符的种类 50

4.4.2操作符的优先级 51

4.4.3逻辑操作符(Logical Operator) 51

4.4.4关系操作符(Relational Operator) 51

4.4.5算术操作符(Arithmetic Operator) 52

4.5 VHDL的顺序语句(Sequential Statement) 53

4.5.1赋值语句 54

4.5.2流程控制语句 56

4.5.3等待语句(WAIT) 60

4.5.4子程序调用语句 61

4.5.5返回语句(RETURN) 63

4.5.6空操作语句(NULL) 64

4.5.7其他顺序语句 64

4.6 VHDL的并行语句(Concurrent Statement) 66

4.6.1 块语句(Block Statement) 66

4.6.2进程语句(Process Statement) 69

4.6.3并行过程调用语句(Concurrent Procedure Call) 72

4.6.4并行信号赋值语句(Concurrent Signal Assignment) 73

4.6.5元件例化语句(Component Instantiation) 75

4.6.6生成语句(Generate Statement) 77

5.1.2基本结构及分类 80

5.1.1概述 80

5.1可编程逻辑器件的基本结构及分类 80

第5章可编程逻辑器件 80

5.2低密度可编程逻辑器件GAL 85

5.2.1 GAL器件的基本结构 85

5.2.2 GAL器件的介绍 88

5.2.3 应用GAL的设计 91

5.3复杂可编程逻辑器件CPLD 93

5.3.1 CPLD的基本结构 94

5.3.2 Altera公司的器件特点 94

5.3.3 Lattice公司的器件产品 106

5.4现场可编程门阵列(FPGA)的基本结构 112

5.4.1FPGA的整体结构 112

5.4.2 Spartan-Ⅱ E系列的基本结构 113

5.4.3 Xilinx FPGA其他系列简介 117

5.5.1 在系统可编程数字开关GDS和互连器件GDX 120

5.5其他可编程器件 120

5.5.2在系统可编程模拟器件 125

第6章开发软件 132

6.1 MAX+plus Ⅱ 简介 132

6.2 MAX+plus Ⅱ的安装 133

6.3 MAX+plus Ⅱ的应用 134

6.3.1 MAX+plus Ⅱ下的VHDL实例 135

6.3.2利用库快速生成功能模块文件 145

6.4 ispLEVER简介 152

6.5 ispLEVER开发工具的原理图输入 152

6.6 ispLEVER工具中用VHDL和Verilog语言输入的设计方法 156

实例1 设计3-8译码器 161

第7章设计实例 161

实例2设计BCD-七段显示译码器 163

实例3设计计数器 165

实例4设计模拟74LS160计数器 169

实例5设计交通灯控制器 171

实例6设计乒乓球游戏机 174

实例7设计扫描数码显示器 175

实例8数字频率计的设计 178

实例9设计数字钟 182

实例10正弦信号发生器 194

附录A缩略语词汇表 200

附录B常用可编程逻辑器件引脚图 202

参考文献 210